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DSP硬件设计需要知道的注意事项

DSP硬件设计需要知道的注意事项

本文摘要:数字信号处理芯片(DSP)具备高性能的CPU(时钟性能多达100MHZ)和高速先进设备外围设备,通过CMOS处置技术,DSP芯片的功耗越来越低。这些极大的变革减少了DSP电路板设计的复杂性,并且同非常简单的数字电路设计相比较,面对更加多相近的问题。 以下是DSP硬件设计的一些注意事项,遵供参考。

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数字信号处理芯片(DSP)具备高性能的CPU(时钟性能多达100MHZ)和高速先进设备外围设备,通过CMOS处置技术,DSP芯片的功耗越来越低。这些极大的变革减少了DSP电路板设计的复杂性,并且同非常简单的数字电路设计相比较,面对更加多相近的问题。  以下是DSP硬件设计的一些注意事项,遵供参考。  时钟电路自由选择原则  1,系统中拒绝多个有所不同频率的时钟信号时,选用可编程时钟芯片;  2,单一时钟信号时,自由选择晶体时钟电路;  3,多个同频时钟信号时,自由选择晶振;  4,尽可能用于DSP片内的PLL,减少片外时钟频率,提升系统的稳定性;  5,C6000、C5510、C5409A、C5416、C5420、C5421和C5441等DSP片内无振荡电路,无法用晶体时钟电路;  6,VC5401、VC5402、VC5409和F281x等DSP时钟信号的电平为1.8V,建议使用晶体时钟电路  加有的输出/输入插槽的处置  1,加有的输出插槽无法悬空不相接,而不应将它们上拉活下拉为相同的电平  1)关键的掌控输出插槽,如Ready、Hold等,不应相同接为必要的状态,Ready插槽不应相同接为有效地状态,Hold插槽不应相同接为违宪状态  2)无相连(NC)和保有(RSV)插槽,NC插槽:除非类似解释,这些插槽悬空不相接,RSV插槽:不应根据数据手册明确要求相接还是不相接  3)非关键的输出插槽,将它们上拉或下拉为相同的电平,以降低功耗  2,加有的输入插槽可以悬空不相接  3,加有的I/O插槽:如果确省状态为输出插槽,则作为非关键的输出插槽处置,上拉或下拉为相同的电平;如果确省状态为输入插槽,则可以悬空不相接  为什么要片内RAM大的DSP效率高?  目前DSP发展的片内存储器RAM更加大,要设计高效的DSP系统,就应当自由选择片内RAM较小的DSP。

片内RAM同片外存储器比起,有以下优点:  1)片内RAM的速度较慢,可以确保DSP无等候运营。  2)对于C2000/C3x/C5000系列,部分片内存储器可以在一个指令周期内采访两次,使得指令可以更为高效。

  3)片内RAM运营平稳,不不受外部的阻碍影响,也会阻碍外部。  4)DSP片内多总线,在采访片内RAM时,会影响其它总线的采访,效率较高。  如何撰写DSP外部的Flash?  DSP的外部Flash撰写方法:  1.通过编程器撰写:将OUT文件通过HEX切换程序转换为编程器可以拒绝接受的格式,再行由编程器撰写。

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  2.通过DSP软件撰写:您必须根据Flash的解释,撰写Flash的编写程序,将应用程序和撰写Flash的程序分别load到RAM中,运营编写程序撰写。  DSP外接存储器的掌控方式  对于一般的存储器具备RD、WR和CS等掌控信号,许多DSP(C3x、C5000)都没掌控信号必要相连存储器,一般使用的方式如下:  1.CS有地址线和PS、DS或STRB译码产生;  2./RD=/STRB+/R/W;3./WR=/STRB+R/W。  5V/3.3V如何混接?  DSP的发展同集成电路的发展一样,新的DSP都是3.3V的,但目前还有许多外围电路是5V的,因此在DSP系统中,常常有5V和3.3V的DSP混接问题。在这些系统中,不应留意:  1)DSP输入给5V的电路(如D/A),需要特任何缓冲器电路,可以必要相连。

  2)DSP输出5V的信号(如A/D),由于输出信号的电压》4V,多达了DSP的电源电压,DSP的外部信号没维护电路,必须特缓冲器,如74LVC245等,将5V信号转换成3.3V的信号。  3)仿真器的JTAG口的信号也必需为3.3V,否则有可能损毁DSP。  DSP工作的基本条件:  1)DSP电源和地相连准确。

  2)DSP时钟准确。  3)DSP的掌控信号RS和HOLD信号相接高电平。

  4)C2000的watchdog开动。


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